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Orientación Universidad
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tarea4 electronica digital unad, Ejercicios de Electrónica

Actividad 4 curso electronica digital UNAD

Tipo: Ejercicios

2019/2020

Subido el 09/07/2020

hans-bernal
hans-bernal 🇨🇴

4.4

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ELECTRONICA DIGITAL 243004A_612
Unidad 2: Tarea 4 Circuitos secuenciales
Integrantes
Hans Enrique Bernal
Código: 72.099.153
Grupo: 243004_6
21 de junio de 2020
Tutor:
Andrés David Suarez
Universidad Nacional Abierta y A Distancia
Escuela de Ciencias Básicas, Tecnología e Ingeniería
CEAD Barranquilla
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ELECTRONICA DIGITAL 243004A_

Unidad 2: Tarea 4 Circuitos secuenciales

Integrantes

Hans Enrique Bernal

Código: 72.099.

Grupo: 243004_

21 de junio de 2020

Tutor:

Andrés David Suarez

Universidad Nacional Abierta y A Distancia

Escuela de Ciencias Básicas, Tecnología e Ingeniería

CEAD Barranquilla

INTRODUCCION

El presente documento tiene como propósito mostrar el desarrollo de circuitos secuenciales en VDHL, como son los latchs o registros, fliflops y contadores por medio del software EDAPlayground, además de poder generar gráficas para cada circuito con las cuales se evidencia su funcionamiento y comportamiento.

Todo esto nos permite poner en práctica los conocimientos sobre las temáticas abordadas en la unidad 3: circuitos secuenciales.

Objetivo general

Implementar circuitos combinacionales por medio de VDHL del software EDAPlayground

Objetivos específicos

 Analizar el comportamiento de los flip-flops y sus diferentes tipos.

 Identificar las diferencias entre latchs y registros.

 Implementar circuitos utilizando estructuras de memoria.

 Afianzar los conocimientos adquiridos en el manejo del software EDA Playground.

  1. Diseñe un registro de 8 bits con reset activo en alto.

a. Un diagrama de bloques.

b. Una impresión de pantalla con la descripción en VHDL

R

Salida

CLK

Reset

Entrada

8 8

c. Una impresión de pantalla con la simulación generada en EDA PLAYGROUND.

  1. Diseñe un contador ascendente módulo N, donde N corresponde a su edad.

a. Un diagrama de bloques diseñado por el estudiante.

b. Una impresión de pantalla con la descripción en VHDL.

CLK

+

37 =N

“0 00000 ” 1

0 D (^) Q

Reset

Salida

Registro

D-bus

Q-bus

c. Una impresión de pantalla con la simulación , en el cual se evidencie el correcto funcionamiento del diseño.

  1. Diseñe un contador descendente módulo M, donde M es su edad. El diseño debe incluir:

a. Un diagrama de bloques diseñado por el estudiante.

  1. Diseñe un contador ascendente/descendente módulo M, donde M es su edad. El diseño debe incluir:

a. Un diagrama de bloques diseñado por el estudiante.

CLK

D Q

Reset

Registro

Q-bus

Sentido

S

Salida

S

S

S

“000000”

“100101”

+

- 1

37

0

b. Una impresión de pantalla con la descripción en VHDL.

c. Una impresión de pantalla con la simulación, en el cual se evidencie el correcto funcionamiento del diseño.

REFERENCIAS BIBLIOGRAFICAS

Muñoz, J. (2012). Introducción a los Sistemas Digitales: Un enfoque usando Lenguajes de Descripción de Hardware. (Capítulos 7, 9 y 10, pp. 135-149,177-208). Madrid. Recuperado de https://openlibra.com/es/book/introduccion-a-los-sistemas-digitales

Flórez, F. H. A. (2010). Diseño lógico: fundamentos de electrónica digital. (Capítulos 5,6 pp. 109-145). Recuperado de: https://ebookcentral-proquest- com.bibliotecavirtual.unad.edu.co/lib/unadsp/reader.action?docID= 073&ppg=

Fajardo, C. (2019, abril 15), Contador con Modulo en EDAPlayground [Archivo de video], Recuperado de: https://youtu.be/S_nmINyWOoQ

Fajardo, C. (2019, abril 15), Contador Descendente en EDAPlayground [Archivo de video], Recuperado de: https://www.youtube.com/watch?v=S_nmINyWOoQ

Fajardo, C. (2019, abril 15), Registro en VHDL en EDA Playground [Archivo de video], Recuperado de: https://youtu.be/tGHL5FyOl1E

Fajardo, C. (2019, abril 15), Contador en EDAPlayground [Archivo de video], Recuperado de: https://youtu.be/Iq7fB09cDO

Fajardo, C. (2016, Diciembre 17), Contadores Digitales [Archivo de video]. Recuperado de http://hdl.handle.net/10596/